威盛面试经验分享 - 范文无忧网

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面试经验一：

我是今天下午1:30去威盛面试的

面试在威盛办公区附近的一个健身房进行-_-

一面的哥哥问的很细,让我详细的介绍自己的项目,然后随时对各个模块的实现进行提问,还要求画出某某模块的实现框图.接着开始让我写代码,晕,简直是没有准备.先写了一个fifo,乱糟糟的写了个大体框架,解释了一下每个process的功能,算是过关.接着又让写了一个Latch和Flip-flop,这个比较简单,直接写出来了.聊完项目,就开始问一些Asic Design Flow,FPGA Design Flow,计算机体系结构的东西,基本上答上来了.面试官看看表,居然才过了20分钟,于是又出了几个hr问题考我,随便答了一下,再聊了聊Via的发展现状,一面结束,耗时30分钟

二面也是一个nice的gg,又让我介绍了一遍项目,而且由于他对我的项目不是很熟,要我详细的解释,让他明白为止.不过这个面试官没有问太细节的技术问题,随便交流了一下,也就是20多分钟,二面结束,让我回去等消息,三四天后leader会决定下一轮面试.

从汇众出来,总觉得面试的很平淡,没什么亮点.结果刚回寝室就接到电话说让我再过去一趟,leader要面我.于是又折回汇众,见到了leader.leader讲话很快,思路也很快.最开始以为我是做软件的,说简历上没看到我写做fpga/asic的经验(简历写的太失败了),于是解释了一下.然后他看我有项目管理经验,就开始和我聊项目管理的问题,说了一些,看样子他还比较满意.接下来又是做题,画一个序列检测器的状态转移图.再下来就是一些asic的细节问题.我提到了formality,他马上问哪些环节需要做formality,formality的里面的算法怎么样的,这个彻底答不上来了,呵呵.又聊了一会儿关于对威盛和logic职位的认识后,他突然说给我offer,真是高兴,连忙感谢.

整个面试过程还是比较愉快的,虽然有些东西不知道,但是还是没有慌神,说出了自己的想法,也得到了一些肯定.今天面试的过程中hr还在打电话通知面试,估计这几天的一面还会进行下去,祝兄弟们好运.HiAll论坛

第一个offer,庆祝一下

面试经验二：

宣讲会没去，据说不着调，让人代投的简历。一周后笔试，笔试题是一本册子，上面各个职位的题目都有，可以自行选择。我只选做了ASIC的一套题。这里列出一部分，网上也可以找到VIA的试卷，题目还是出得不错的。逻辑化简题，给你一个逻辑表达式，必须用特定的逻辑门实现(比如与非门和反相器);

状态机设计，并要求写出状态机部分的代码，最简单的就是序列检测了，需要了解Moore和Melay状态机的实现异同，网上有很多关于论述二段，三段状态机的资料，注意一下代码风格;

改错题，我遇到的代码是异步fifo，有三段，要挑出能够正确实现异步功能的方案，并给出理由;

静态时序分析的一些基本概念，setup/hold time几乎必考，我提供了几份资料，可作参考;多时钟域的信号传输，常见的手段就是通过触发器锁两拍，或者是异步fifio。异步fifo的depth要会计算(我在后面的面试中遇到好几次);

此外，威盛还会考到一些计算机体系结构知识，此次的题目是Cache相关计算(教材上有关Cache映射方式一小节的内容)。

面试在笔试后一周，地点在威盛武汉，面试官是来自上海S3Graphic分部(做GPU的)。第一轮技术面试，技术面主要是我讲项目，他们中间穿插一些问题。针对我的项目内容，面试官主要问了芯片的整体架构，我负责的运算单元这一块的流水线设计，还有如何去验证以保证设计的正确性等等，面试官手上有我的笔试试卷，但是至始至终没有问过。

大约一个半小时后，我被告知在门外等候，面试官在里面填了一份表格，把我交给hr，hr面问了一些常规性问题，已经面试过哪些公司，有没有offer，如果我们给你offer你会不会来，你的期望薪水等等，其间我看到了面试官在我的表格上写有思路清晰，有条理等字样，我认为这是VIA面试顺利通过的一个主因，我认为面试官真正看重的是你如何把一个问题

描述清楚并解决之，这一点在瑞晟的面试中也得到印证。

因为师姐之前在VIA呆过，我向她咨询，她告诉我在那儿工作压力不大，但发展机会也有限，但毕竟是老牌芯片设计公司，技术实力摆在那儿，所以从威盛跳出去的人还是蛮抢手的。威盛的ASIC岗位招人不多，在武汉这边主要是嵌入式软件岗位，北京的不太清楚，我们同

届的某某最后签了威盛北京，据说是做固态硬盘，有兴趣可以问他。